一種準(zhǔn)靜態(tài)容錯(cuò)DVS節(jié)能調(diào)度算法

【摘要】：容錯(cuò)與功耗的均衡最近成為實(shí)時(shí)系統(tǒng)研究中的一個(gè)熱點(diǎn),目前的大多數(shù)工作主要圍繞基于動(dòng)態(tài)電壓調(diào)節(jié)(dynamic voltage scaling,DVS)的節(jié)能技術(shù)和基于時(shí)間冗余的容錯(cuò)技術(shù)展開。本文研究一類存在依賴關(guān)系的硬實(shí)時(shí)多任務(wù)集在容錯(cuò)約束下的功耗優(yōu)化問題,為了充分利用由于任務(wù)實(shí)際執(zhí)行時(shí)間與WCET(最差執(zhí)行時(shí)間)的差值及故障發(fā)生的不確定性而產(chǎn)生的動(dòng)態(tài)slack(空閑時(shí)間),提出一種低在線開銷的準(zhǔn)靜態(tài)DVS容錯(cuò)節(jié)能調(diào)度算法。模擬結(jié)果證明該算法能以較低的在線開銷充分利用動(dòng)態(tài)slack,達(dá)到既滿足容錯(cuò)要求又能使系統(tǒng)能耗大幅降低的目的。 【作者單位】：國防科學(xué)技術(shù)大學(xué)計(jì)算機(jī)學(xué)院 國防科學(xué)技術(shù)大學(xué)計(jì)算機(jī)學(xué)院
【關(guān)鍵詞】：實(shí)時(shí)系統(tǒng) 嵌入式系統(tǒng) 動(dòng)態(tài)電壓調(diào)節(jié) 容錯(cuò) 調(diào)度算法
【分類號】：TP316.2
【正文快照】： 1引言隨著在國防、航空航天、通信和消費(fèi)電子等領(lǐng)域嵌入式應(yīng)用的大量涌現(xiàn),以及CMOS工藝水平的不斷提升,功耗問題和可靠性已經(jīng)成為嵌入式實(shí)時(shí)系統(tǒng)設(shè)計(jì)的兩個(gè)重要挑戰(zhàn),對容錯(cuò)和節(jié)能的研究也成為實(shí)時(shí)系統(tǒng)研究的兩個(gè)熱點(diǎn),但長期以來它們一直都是作為各自獨(dú)立的領(lǐng)域進(jìn)行研究,直到

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