FPGA芯片的節(jié)能設(shè)計(jì)技術(shù)

【摘要】：本文的側(cè)重點(diǎn)在于討論那些用于減少功耗的設(shè)計(jì)技術(shù)。這些設(shè)計(jì)經(jīng)驗(yàn)及設(shè)計(jì)規(guī)則包括了設(shè)計(jì)周期中不同的幾個(gè)方面,包括在系統(tǒng)級(jí)、寄存器傳輸級(jí)(RTL)及低層等幾個(gè)方面的技術(shù)。 【作者單位】： 華中科技大學(xué) 廣州金鵬集團(tuán)有限公司
【關(guān)鍵詞】： 功率模型 功耗預(yù)算 轉(zhuǎn)換速率 節(jié)能技術(shù)
【分類號(hào)】：TN402
【正文快照】： :0、引 言 功耗預(yù)算越來(lái)越顯得緊迫且在設(shè)計(jì)周期的 早期階段中愈值得注意,電池供電、手持、醫(yī) 學(xué)及叫絡(luò)等應(yīng)用是尤為明顯的功率敏感系統(tǒng)。 本史分成血章。第一章介紹及分析了公用的用 f建立靜念及動(dòng)態(tài)功耗的原理性的模型,該分 析淪證和說(shuō)明了理論與實(shí)際量度硅片的功耗之 問(wèn)的

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